ASML High-NA EUV: chips de 8 nm y la Ley de Moore en la IA

Qué es el sistema High-NA EUV y por qué es un hito en la historia de los chips

Cuando hablamos de litografía EUV, hablamos de la tecnología que hace posible imprimir los circuitos más pequeños que la humanidad ha fabricado jamás. Y ASML, la empresa neerlandesa que monopoliza esta disciplina a nivel mundial, acaba de redefinir los límites de lo posible: su nuevo sistema High-NA EUV (modelo TWINSCAN EXE:5000 / EXE:5200) imprime transistores con una dimensión crítica de apenas 8 nanómetros en un solo paso de exposición, algo que ninguna máquina comercial había conseguido hasta ahora.

Para los founders que construyen sobre infraestructura de IA, este avance no es solo una noticia técnica: es la respuesta industrial a la demanda exponencial de cómputo que genera el entrenamiento de modelos de lenguaje, visión y razonamiento. Más transistores por milímetro cuadrado significa chips más rápidos, más eficientes y, a largo plazo, más accesibles para el ecosistema tech global.

Especificaciones técnicas: la ingeniería detrás del gigante de 165 toneladas

El equipo High-NA EUV de ASML no es una máquina discreta. Mide más que un autobús de dos pisos, pesa 165 toneladas y requiere un proceso de instalación que involucra 250 ingenieros durante seis meses. Su transporte desde los Países Bajos a las fábricas de clientes necesita 7 aviones de carga y 50 camiones.

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¿Cómo genera luz EUV de 13,5 nanómetros de longitud de onda? Disparando un láser CO2 contra gotas de estaño calentadas a más de 220.000 grados Celsius. Esa luz es luego dirigida y enfocada mediante espejos ultra-precisos de molibdeno y silicio, con tolerancias inferiores a un átomo. La apertura numérica (NA) de 0,55 —frente a los 0,33 NA de los sistemas EUV anteriores— es lo que permite alcanzar esa resolución de 8 nm sin necesidad de múltiples exposiciones superpuestas (el proceso conocido como multipatroneo).

El throughput alcanza hasta 175 obleas por hora, y su precio por unidad ronda los 300–370 millones de dólares, el doble que una máquina EUV convencional (Low-NA).

El salto frente al EUV anterior: más resolución, menos pasos, mayor densidad

La comparación entre el sistema Low-NA EUV (0,33 NA) y el nuevo High-NA EUV (0,55 NA) ilustra por qué la industria lleva años esperando este equipo:

Resolución: el sistema anterior alcanzaba entre 10 y 13 nm; el nuevo llega a 8 nm.
Densidad de transistores: 2,9 veces más transistores por unidad de área, lo que se traduce directamente en chips más potentes sin aumentar el tamaño del die.
Proceso simplificado: al imprimir en un solo paso, se eliminan capas de multipatroneo, reduciendo costos de fabricación y margen de error.
Transistores un 1,7 veces más pequeños respecto a los producidos con tecnología Low-NA.
Costo: 300–370 M USD por unidad (vs. ~150–200 M USD del sistema anterior).

La Ley de Moore: ¿muerta o resucitada por High-NA EUV?

La famosa Ley de Moore —que predice que el número de transistores en un chip se duplica aproximadamente cada dos años— lleva más de una década en cuidados intensivos. La física cuántica, los límites del calor y los costos de fabricación han hecho cada vez más difícil mantener ese ritmo. El High-NA EUV de ASML es quizás el argumento más sólido de que ese ciclo puede continuar, al menos durante otra generación de chips.

Con nodos sub-2 nm como el Intel 18A apoyándose en partes del proceso High-NA EUV, y con densidades de transistores saltando casi al triple en un solo paso tecnológico, el ecosistema chip puede sustentar las necesidades computacionales de modelos de IA con decenas —o cientos— de miles de millones de parámetros. El mercado de semiconductores se proyecta en más de 1 billón de dólares para 2030, con la IA como principal motor de ese crecimiento.

Intel y SK hynix: los primeros en la fila

Intel fue el primer cliente en recibir un sistema High-NA EUV, instalado en sus instalaciones de Oregon (EE.UU.) en enero de 2024. La empresa completó el montaje en abril de ese año y aseguró prácticamente todo el stock disponible de 2024 —estimado en entre 5 y 10 unidades—, lo que refleja tanto la escasez del equipo como la apuesta estratégica de Intel por recuperar el liderazgo en manufactura de chips frente a TSMC y Samsung.

SK hynix figura también entre los destinatarios del equipo, aunque los detalles de sus entregas no han sido confirmados públicamente con la misma granularidad. TSMC y Samsung, por su parte, siguen perfeccionando nodos de 2 nm con sistemas Low-NA EUV, con la adopción de High-NA prevista para generaciones posteriores.

Hasta la fecha, se estima que hay alrededor de diez unidades enviadas a clientes en todo el mundo, una cifra que ilustra cuán exclusivo —y estratégico— es el acceso a esta tecnología.

El frente geopolítico: ASML como arma tecnológica de Occidente

Ningún análisis del ecosistema High-NA EUV estaría completo sin abordar el tablero geopolítico. Desde 2019, EE.UU. y los Países Bajos han impuesto restricciones de exportación que bloquean a China el acceso a sistemas EUV avanzados. Esas restricciones se endurecieron entre 2023 y 2024, extendiendo el bloqueo a nodos inferiores a 14 nm.

El resultado práctico: China no puede acceder al High-NA EUV, lo que limita severamente su capacidad para producir chips de IA de vanguardia de forma autónoma. Esto convierte a ASML en una pieza clave de la estrategia tecnológica occidental para mantener la ventaja en semiconductores avanzados. Mientras tanto, China invierte masivamente en alternativas de litografía DUV mejorada, aunque la brecha con EUV sigue siendo enorme.

En el frente financiero, Zeiss —el socio óptico alemán de ASML— está ampliando capacidad productiva para 2026, y ASML proyecta ingresos de entre 38.000 y 40.000 millones de euros para ese año, impulsados en gran medida por la demanda de chips para IA.

¿Qué viene después? Hyper-NA EUV en el horizonte de 2030

ASML ya tiene en desarrollo la siguiente generación: Hyper-NA EUV (0,75 NA), prevista para alrededor de 2030. Si High-NA representó el salto de 0,33 a 0,55 NA, Hyper-NA empujará aún más los límites de la resolución, habilitando nodos que hoy resultan impensables.

El ciclo de innovación en litografía, lejos de detenerse, se está acelerando. Y cada salto tecnológico en esta cadena redefine lo que es posible en IA, computación cuántica y cualquier dominio que dependa de chips de alto rendimiento.

Implicaciones para founders tech: ¿por qué esto te importa?

Si construyes productos sobre infraestructura de IA —modelos generativos, visión computacional, procesamiento de lenguaje natural—, el avance de ASML impacta directamente en tus costos y capacidades futuras. Más transistores por chip significa:

Mayor poder de cómputo a igual consumo energético.
GPUs y TPUs más densas para entrenamiento e inferencia.
Reducción gradual del costo por FLOP en la próxima generación de hardware.
Acceso a modelos más grandes sin incrementos proporcionales en infraestructura.

Para el ecosistema startup, esto se traduce en una ventana de oportunidad: los próximos 3–5 años verán una expansión significativa en la capacidad de cómputo disponible, y los founders que entiendan esta curva tecnológica estarán mejor posicionados para anticipar cuándo sus productos pueden escalar a costos que hoy parecen inviables.

Conclusión

El High-NA EUV de ASML no es solo un hito de ingeniería; es el eslabón que mantiene viva la promesa de la Ley de Moore en la era de la inteligencia artificial. Con transistores de 8 nanómetros impresos en un solo paso, una densidad 2,9 veces superior a la generación anterior, y un puñado de unidades disponibles para los gigantes de la fabricación, esta máquina de 165 toneladas definirá la frontera del cómputo durante la próxima década.

Para los founders tech que apuestan por la IA, entender esta cadena —desde la litografía hasta el chip, del chip al modelo, del modelo al producto— es una ventaja competitiva real. El hardware es la base. Y la base acaba de hacerse más sólida.

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